Division
This commit is contained in:
@ -220,7 +220,7 @@ static void execute_op(Hart* hart, uint32_t instruction)
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}
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else if (bank == 1)
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{
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if ((inst.funct3 & 0x8) == 0)
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if ((inst.funct3 & 0x4) == 0)
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{
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uint64_t a = hart->regs[inst.rs1];
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uint64_t b = hart->regs[inst.rs2];
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@ -241,7 +241,68 @@ static void execute_op(Hart* hart, uint32_t instruction)
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}
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else
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{
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assert(!"Unhandled M OP");
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uint32_t a = hart->regs[inst.rs1];
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uint32_t b = hart->regs[inst.rs2];
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switch (inst.funct3 & 0x3)
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{
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case 0: // DIV
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{
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if (b == 0)
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{
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hart->regs[inst.rd] = 0xFFFFFFFF;
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}
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else if (a == 0x80000000 && b == 0xFFFFFFFF)
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{
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hart->regs[inst.rd] = 0x80000000;
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}
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else
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{
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hart->regs[inst.rd] = (uint32_t)((int32_t)a / (int32_t)b);
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}
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break;
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}
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case 1: // DIVU
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{
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if (b == 0)
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{
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hart->regs[inst.rd] = 0xFFFFFFFF;
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}
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else
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{
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hart->regs[inst.rd] = a / b;
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}
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break;
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}
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case 2: // REM
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{
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if (b == 0)
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{
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hart->regs[inst.rd] = a;
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}
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else if (a == 0x80000000 && b == 0xFFFFFFFF)
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{
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hart->regs[inst.rd] = 0;
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}
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else
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{
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hart->regs[inst.rd] = (uint32_t)((int32_t)a % (int32_t)b);
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}
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break;
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}
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case 3: // REMU
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{
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if (b == 0)
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{
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hart->regs[inst.rd] = a;
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}
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else
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{
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hart->regs[inst.rd] = a % b;
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}
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||||
break;
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}
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}
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}
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}
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else
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@ -263,6 +263,36 @@ static void test_m()
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execute(&hart, 0x022091b3); // mulh x3, x1, x2
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assert(hart.regs[3] == 0x00000000);
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hart.regs[1] = (uint32_t)-63;
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hart.regs[2] = 4;
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execute(&hart, 0x0220c1b3); // div x3, x1, x2
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assert(hart.regs[3] == (uint32_t)-15);
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execute(&hart, 0x0220d1b3); // divu x3, x1, x2
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assert(hart.regs[3] == 0x3FFFFFF0);
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execute(&hart, 0x0220e1b3); // rem x3, x1, x2
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assert(hart.regs[3] == (uint32_t)-3);
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execute(&hart, 0x0220f1b3); // remu x3, x1, x2
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assert(hart.regs[3] == 1);
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hart.regs[1] = 30;
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hart.regs[2] = 0;
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execute(&hart, 0x0220c1b3); // div x3, x1, x2
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assert(hart.regs[3] == 0xFFFFFFFF);
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execute(&hart, 0x0220d1b3); // divu x3, x1, x2
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assert(hart.regs[3] == 0xFFFFFFFF);
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execute(&hart, 0x0220e1b3); // rem x3, x1, x2
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||||
assert(hart.regs[3] == 30);
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execute(&hart, 0x0220f1b3); // remu x3, x1, x2
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assert(hart.regs[3] == 30);
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}
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int main(int argc, char* argv[])
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